Multi-dimensional reconciliation encoder with quasi-cyclic LDPC codes on FPGA

Origlia, M.;Andriolli, N.;Maggiani, L.;Castoldi, P.;Secondini, M.;Forestieri, E.;
2023-01-01

2023
979-8-3503-0303-2
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Utilizza questo identificativo per citare o creare un link a questo documento: https://hdl.handle.net/11382/558992
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